文件名称:reg8b
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8位寄存器设计,用VHDL语言编写,用于DDS信号源中项目-8 registers design using VHDL language for DDS signal source project
(系统自动生成,下载前可以参看下载内容)
下载文件列表
reg8b
.....\db
.....\..\prev_cmp_reg8b.qmsg
.....\..\prev_cmp_reg8b.sim.qmsg
.....\..\reg8b.asm.qmsg
.....\..\reg8b.cbx.xml
.....\..\reg8b.cmp.cdb
.....\..\reg8b.cmp.hdb
.....\..\reg8b.cmp.logdb
.....\..\reg8b.cmp.rdb
.....\..\reg8b.cmp.tdb
.....\..\reg8b.cmp0.ddb
.....\..\reg8b.db_info
.....\..\reg8b.dbp
.....\..\reg8b.eco.cdb
.....\..\reg8b.eds_overflow
.....\..\reg8b.fit.qmsg
.....\..\reg8b.hier_info
.....\..\reg8b.hif
.....\..\reg8b.map.cdb
.....\..\reg8b.map.hdb
.....\..\reg8b.map.logdb
.....\..\reg8b.map.qmsg
.....\..\reg8b.pre_map.cdb
.....\..\reg8b.pre_map.hdb
.....\..\reg8b.psp
.....\..\reg8b.pss
.....\..\reg8b.rtlv.hdb
.....\..\reg8b.rtlv_sg.cdb
.....\..\reg8b.rtlv_sg_swap.cdb
.....\..\reg8b.sgdiff.cdb
.....\..\reg8b.sgdiff.hdb
.....\..\reg8b.sim.cvwf
.....\..\reg8b.sim.hdb
.....\..\reg8b.sim.qmsg
.....\..\reg8b.sim.rdb
.....\..\reg8b.sld_design_entry.sci
.....\..\reg8b.sld_design_entry_dsc.sci
.....\..\reg8b.syn_hier_info
.....\..\reg8b.tan.qmsg
.....\..\reg8b.tis_db_list.ddb
.....\..\wed.wsf
.....\reg8b.asm.rpt
.....\reg8b.bsf
.....\reg8b.done
.....\reg8b.fit.rpt
.....\reg8b.fit.summary
.....\reg8b.flow.rpt
.....\reg8b.map.rpt
.....\reg8b.map.summary
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.....\reg8b.pof
.....\reg8b.qpf
.....\reg8b.qsf
.....\reg8b.qws
.....\reg8b.sim.rpt
.....\reg8b.sof
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.....\reg8b.tan.summary
.....\reg8b.vhd
.....\reg8b.vwf