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文件名称:Seven-voting-machines

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2013-07-17
  • 文件大小：
  • 46kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • t***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

用verilog编写的七人表决器代码·可以实现七人表决超过四人就通过的功能-Written in verilog seven voting machine code can be achieved seven people to vote on the adoption of more than four functions
(系统自动生成,下载前可以参看下载内容)

下载文件列表





work1

.....\voter_7.cr.mti

.....\voter_7.mpf

.....\voter_7.vo

.....\voter_7_tb.v

.....\voter_7_tb.v.bak

.....\voter_7_v.sdo

.....\voter_7_v.sdo_typ.csd

.....\vsim.wlf

.....\work

.....\....\voter_7

.....\....\.......\verilog.asm64

.....\....\.......\verilog.rw64

.....\....\.......\_primary.dat

.....\....\.......\_primary.dbs

.....\....\.......\_primary.vhd

.....\....\voter_7_tb

.....\....\..........\verilog.asm64

.....\....\..........\verilog.rw64

.....\....\..........\_primary.dat

.....\....\..........\_primary.dbs

.....\....\..........\_primary.vhd

.....\....\_info

.....\....\_temp

.....\....\_vmake

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