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文件名称:seven-segment-decoder

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2013-07-17
  • 文件大小：
  • 55kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • t***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

简单的七段译码器的verilogDHL代码·虽然很简单 但是希望能到这学习到更多的东西-Simple seven-segment decoder verilogDHL code although very simple but hope to learn more things that
(系统自动生成,下载前可以参看下载内容)

下载文件列表





work4

.....\Vr7seg.cr.mti

.....\Vr7seg.mpf

.....\Vr7seg.vo

.....\Vr7seg_tb.v

.....\Vr7seg_tb.v.bak

.....\Vr7seg_v.sdo

.....\Vr7seg_v.sdo_typ.csd

.....\vsim.wlf

.....\work

.....\....\@vr7seg

.....\....\.......\verilog.asm64

.....\....\.......\verilog.rw64

.....\....\.......\_primary.dat

.....\....\.......\_primary.dbs

.....\....\.......\_primary.vhd

.....\....\@vr7seg_tb

.....\....\..........\verilog.asm64

.....\....\..........\verilog.rw64

.....\....\..........\_primary.dat

.....\....\..........\_primary.dbs

.....\....\..........\_primary.vhd

.....\....\_info

.....\....\_temp

.....\....\_vmake

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