文件名称:clock

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [ASM] [源码]
  • 上传时间:
  • 2013-06-23
  • 文件大小:
  • 913kb
  • 下载次数:
  • 0次
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介绍说明--下载内容均来自于网络,请自行研究使用

设计一台能显示时、分、秒的数字电子钟,具体要求如下:

(1)时计数器用24进制计时电路,分、秒计数器用60进制计分、计秒电路;

(2)可手动校时,能分别进行时、分的校正;

(3)能实现整点报时功能。

-Design a table can display hours, minutes and seconds of digital electronic clock, the specific requirements are as follows: (a) when the counter with 24 hexadecimal timing circuits, minutes, seconds counter with 60 decimal points, namely, second circuit (2) may be Manually school, be able to separate hours, minutes correction (3) to achieve the whole point timekeeping function.
(系统自动生成,下载前可以参看下载内容)

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clock

.....\ALERT.bsf

.....\ALERT.cmp

.....\ALERT.inc

.....\alert.done

.....\alert.flow.rpt

.....\alert.map.rpt

.....\alert.map.summary

.....\alert.qpf

.....\alert.qsf

.....\alert.qws

.....\alert.sim.rpt

.....\alert.vhd

.....\alert.vwf

.....\clock.bdf

.....\clock.done

.....\clock.flow.rpt

.....\clock.map.rpt

.....\clock.map.summary

.....\clock.qpf

.....\clock.qsf

.....\clock.qws

.....\clock.sim.rpt

.....\clock.vwf

.....\db

.....\..\alert.cbx.xml

.....\..\alert.cmp.rdb

.....\..\alert.cmp_merge.kpt

.....\..\alert.db_info

.....\..\alert.eco.cdb

.....\..\alert.eds_overflow

.....\..\alert.fnsim.cdb

.....\..\alert.fnsim.hdb

.....\..\alert.fnsim.qmsg

.....\..\alert.hier_info

.....\..\alert.hif

.....\..\alert.lpc.html

.....\..\alert.lpc.rdb

.....\..\alert.lpc.txt

.....\..\alert.map.bpm

.....\..\alert.map.cdb

.....\..\alert.map.ecobp

.....\..\alert.map.hdb

.....\..\alert.map.kpt

.....\..\alert.map.logdb

.....\..\alert.map.qmsg

.....\..\alert.map_bb.cdb

.....\..\alert.map_bb.hdb

.....\..\alert.map_bb.logdb

.....\..\alert.pre_map.cdb

.....\..\alert.pre_map.hdb

.....\..\alert.rtlv.hdb

.....\..\alert.rtlv_sg.cdb

.....\..\alert.rtlv_sg_swap.cdb

.....\..\alert.sgdiff.cdb

.....\..\alert.sgdiff.hdb

.....\..\alert.sim.cvwf

.....\..\alert.sim.hdb

.....\..\alert.sim.qmsg

.....\..\alert.sim.rdb

.....\..\alert.simfam

.....\..\alert.sld_design_entry.sci

.....\..\alert.sld_design_entry_dsc.sci

.....\..\alert.syn_hier_info

.....\..\alert.tis_db_list.ddb

.....\..\alert.tmw_info

.....\..\clock.cbx.xml

.....\..\clock.cmp.rdb

.....\..\clock.cmp_merge.kpt

.....\..\clock.db_info

.....\..\clock.eco.cdb

.....\..\clock.eds_overflow

.....\..\clock.fnsim.cdb

.....\..\clock.fnsim.hdb

.....\..\clock.fnsim.qmsg

.....\..\clock.hier_info

.....\..\clock.hif

.....\..\clock.lpc.html

.....\..\clock.lpc.rdb

.....\..\clock.lpc.txt

.....\..\clock.map.bpm

.....\..\clock.map.cdb

.....\..\clock.map.ecobp

.....\..\clock.map.hdb

.....\..\clock.map.kpt

.....\..\clock.map.logdb

.....\..\clock.map.qmsg

.....\..\clock.map_bb.cdb

.....\..\clock.map_bb.hdb

.....\..\clock.map_bb.logdb

.....\..\clock.pre_map.cdb

.....\..\clock.pre_map.hdb

.....\..\clock.rtlv.hdb

.....\..\clock.rtlv_sg.cdb

.....\..\clock.rtlv_sg_swap.cdb

.....\..\clock.sgdiff.cdb

.....\..\clock.sgdiff.hdb

.....\..\clock.sim.cvwf

.....\..\clock.sim.hdb

.....\..\clock.sim.qmsg

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