文件名称:APB3_slave_libero
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libero环境下实现的smartfusion开发板的arm和FPGA通信的硬件设计-libero environment SmartFusion development board ARM and FPGA hardware design of the communication
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下载文件列表
APB3_slave_libero\APB3_slave_libero.prj
.................\component\Actel\DirectCore\CoreAPB3\3.0.103\CoreAPB3.cxf
.................\.........\.....\..........\........\.......\coreparameters.v
.................\.........\.....\..........\........\.......\mti\scripts\bfmtovec.exe
.................\.........\.....\..........\........\.......\...\.......\bfmtovec.lin
.................\.........\.....\..........\........\.......\...\.......\bfmtovec_compile.tcl
.................\.........\.....\..........\........\.......\...\.......\coreapb3_usertb_apb_master.bfm
.................\.........\.....\..........\........\.......\...\.......\coreapb3_usertb_apb_master.vec
.................\.........\.....\..........\........\.......\...\.......\coreapb3_usertb_include.bfm
.................\.........\.....\..........\........\.......\...\.......\wave_user.do
.................\.........\.....\..........\........\.......\...\user_vlog\COREAPB3_LIB\@b@f@m@a1l1@o@i@i\verilog.prw
.................\.........\.....\..........\........\.......\...\.........\............\.................\verilog.psm
.................\.........\.....\..........\........\.......\...\.........\............\.................\_primary.dat
.................\.........\.....\..........\........\.......\...\.........\............\.................\_primary.dbs
.................\.........\.....\..........\........\.......\...\.........\............\.................\_primary.vhd
.................\.........\.....\..........\........\.......\...\.........\............\......_@a@p@b\verilog.prw
.................\.........\.....\..........\........\.......\...\.........\............\.............\verilog.psm
.................\.........\.....\..........\........\.......\...\.........\............\.............\_primary.dat
.................\.........\.....\..........\........\.......\...\.........\............\.............\_primary.dbs
.................\.........\.....\..........\........\.......\...\.........\............\.............\_primary.vhd
.................\.........\.....\..........\........\.......\...\.........\............\.............@s@l@a@v@e\verilog.prw
.................\.........\.....\..........\........\.......\...\.........\............\.......................\verilog.psm
.................\.........\.....\..........\........\.......\...\.........\............\.......................\_primary.dat
.................\.........\.....\..........\........\.......\...\.........\............\.......................\_primary.dbs
.................\.........\.....\..........\........\.......\...\.........\............\.......................\_primary.vhd
.................\.........\.....\..........\........\.......\...\.........\............\.......................@e@x@t\verilog.prw
.................\.........\.....\..........\........\.......\...\.........\............\.............................\verilog.psm
.................\.........\.....\..........\........\.......\...\.........\............\.............................\_primary.dat
.................\.........\.....\..........\........\.......\...\.........\............\.............................\_primary.dbs
.................\.........\.....\..........\........\.......\...\.........\............\.............................\_primary.vhd
.................\.........\.....\..........\........\.......\...\.........\............\........m@a@i@n\verilog.prw
.................\.........\.....\..........\........\.......\...\.........\............\...............\verilog.psm
.................\.........\.....\..........\........\.......\...\.........\............\...............\_primary.dat
.................\.........\.....\..........\........\.......\...\.........\............\...............\_primary.dbs
.................\.........\.....\..........\........\.......\...\.........\............\...............\_primary.vhd
.................\.........\.....\..........\........\.......\...\.........\............\_info
.................\.........\.....\..........\........\.......\...\.........\.........