文件名称:daima

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2013-04-25
  • 文件大小:
  • 141kb
  • 下载次数:
  • 0次
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Verilog HDL应用程序设计实例代码-Verilog HDL
(系统自动生成,下载前可以参看下载内容)

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光盘代码
........\第10章
........\......\chipfifolmp
........\......\...........\chipfifolmp.vwf
........\......\...........\lpm_fifo_dc0.v
........\......\...........\lpm_fifo_dc0_bb.v
........\......\chipfifoone
........\......\...........\chipfifoone.v
........\......\...........\chipfifoone.vwf
........\......\chipsramlmp
........\......\...........\altdpram0.v
........\......\...........\altdpram0_bb.v
........\......\...........\chipsramlmp.vwf
........\......\chipsramone
........\......\...........\chipsramone.v
........\......\...........\chipsramone.vwf
........\......\outramone
........\......\.........\outramone.v
........\......\.........\outramone.vwf
........\......\.........\testoutramone.v
........\......\shipromlmp
........\......\..........\lpm_rom0.v
........\......\..........\lpm_rom0_bb.v
........\......\..........\shipromlmp.mif
........\......\..........\shipromlmp.vwf
........\......\shipromone
........\......\..........\chipromone.v
........\......\..........\chipromone.vwf
........\......\shipsramone
........\......\...........\db
........\......\...........\..\shipsramone.db_info
........\......\...........\..\shipsramone.eco.cdb
........\......\...........\..\shipsramone.sld_design_entry.sci
........\......\异步FIFO设计
........\......\............\async_cmp.v
........\......\............\async_fifo.v
........\......\............\dp_ram.v
........\......\............\rptr_empty.v
........\......\............\wptr_full.v
........\第11章
........\......\CORDIC数字计算机的设计
........\......\......................\cordic.v
........\......\I2C Master
........\......\..........\i2c.v
........\......\..........\iicwr.vwf
........\......\..........\testi2c.v
........\......\RS(204188)译码器的设计
........\......\.......................\BM_KES.v
........\......\.......................\CheinSearch.v
........\......\.......................\ROM_INV.mif
........\......\.......................\RS(204188)译码器说明.txt
........\......\.......................\SyndromeCalc.v
........\......\.......................\ff_mul.v
........\......\.......................\forney.v
........\......\.......................\rom_inv.v
........\......\.......................\rom_power.mif
........\......\.......................\rom_power.v
........\......\.......................\rs_decoder.v
........\......\RS编码器
........\......\........\mul_encode.vhd
........\......\........\mula_0.v
........\......\........\mula_1.v
........\......\........\mula_10.v
........\......\........\mula_11.v
........\......\........\mula_12.v
........\......\........\mula_13.v
........\......\........\mula_14.v
........\......\........\mula_15.v
........\......\........\mula_16.v
........\......\........\mula_17.v
........\......\........\mula_18.v
........\......\........\mula_2.v
........\......\........\mula_21.v
........\......\........\mula_22.v
........\......\........\mula_25.v
........\......\........\mula_3.v
........\......\........\mula_31.v
........\......\........\mula_32.v
........\......\........\mula_35.v
........\......\........\mula_38.v
........\......\........\mula_4.v
........\......\........\mula_45.v
........\......\........\mula_48.v
........\......\........\mula_5.v
........\......\........\mula_51.v
........\......\........\mula_59.v
........\......\........\mula_6.v
........\......\........\mula_61.v
........\......\........\mula_7.v
........\......\........\mula_8.v
........\......\........\mula_9.v
........\......\........\rscode.v
........\......\........\rscode.vhd
........\......\........\rscode.vwf
........\......\........\rstestbench.vhd
........\......\........\testbenchmul.vhd
........\......\........\testbenchmul_encode.vhd
........\......\SPI Master
........\......\..........\clkdiv.v
........\......\..........\spi.vwf

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