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文件名称:xuliejianceqi

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2013-04-22
  • 文件大小：
  • 237kb
  • 下载次数：
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

在FPGA开发板上用硬件描述语言实现一个状态序列检测器，比如边沿检测器等-FPGA　verilog
(系统自动生成,下载前可以参看下载内容)

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状态机实现序列检测器用verilog语言实现.doc

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