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功能：基于VHDL语言，实现对ADC0809简单控制
--说明：ADC0809没有内部时钟，需外接10KHz~1290Hz的时钟信号，这里由FPGA的系
--统时钟（50MHz）经256分频得到clk1（195KHz）作为ADC0809转换工作时钟。
-: Based on the VHDL language, ADC0809 simple control- Descr iption: ADC0809 no internal clock, an external clock signal of 10KHz ~ 1290Hz, by the Department of the FPGA- the system clock (50MHz) after divided by 256 the get clk1 (195KHz) as ADC0809 conversion clock.
--说明：ADC0809没有内部时钟，需外接10KHz~1290Hz的时钟信号，这里由FPGA的系
--统时钟（50MHz）经256分频得到clk1（195KHz）作为ADC0809转换工作时钟。
-: Based on the VHDL language, ADC0809 simple control- Descr iption: ADC0809 no internal clock, an external clock signal of 10KHz ~ 1290Hz, by the Department of the FPGA- the system clock (50MHz) after divided by 256 the get clk1 (195KHz) as ADC0809 conversion clock.
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