文件名称:test

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [Windows] [程序]
  • 上传时间:
  • 2013-03-11
  • 文件大小:
  • 242kb
  • 下载次数:
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the carry save adder program in verilog
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test\csa\.lso

....\...\csa.gise

....\...\csa.ise

....\...\csa.prj

....\...\csa.stx

....\...\csa.v

....\...\csa.xise

....\...\csa.xst

....\...\csa_summary.html

....\...\csa_test.v

....\...\csa_test_beh.prj

....\...\csa_test_isim_beh.exe

....\...\csa_test_isim_beh.wdb

....\...\csa_test_isim_beh1.wdb

....\...\csa_test_stx.prj

....\...\....xdb\tmp\ise\version

....\...\.......\...\...\__OBJSTORE__\HierarchicalDesign\HDProject\HDProject

....\...\.......\...\...\............\..................\.........\HDProject_StrTbl

....\...\.......\...\...\............\..................\__stored_object_table__

....\...\.......\...\...\............\PnAutoRun\Scripts\RunOnce_tcl

....\...\.......\...\...\............\.........\.......\RunOnce_tcl_StrTbl

....\...\.......\...\...\............\.rojectNavigator\dpm_project_main\dpm_project_main

....\...\.......\...\...\............\................\................\dpm_project_main_StrTbl

....\...\.......\...\...\............\................Gui\CViewSelector

....\...\.......\...\...\............\...................\CViewSelector_StrTbl

....\...\.......\...\...\............\...................\File-SynthesisOnly

....\...\.......\...\...\............\...................\File-SynthesisOnly_StrTbl

....\...\.......\...\...\............\...................\Library-SynthesisOnly

....\...\.......\...\...\............\...................\Library-SynthesisOnly_StrTbl

....\...\.......\...\...\............\...................\Process-BehavioralSim-

....\...\.......\...\...\............\...................\Process-BehavioralSim-DESUT_VERILOG

....\...\.......\...\...\............\...................\Process-BehavioralSim-DESUT_VERILOG_StrTbl

....\...\.......\...\...\............\...................\Process-BehavioralSim-_StrTbl

....\...\.......\...\...\............\...................\Process-SynthesisOnly-

....\...\.......\...\...\............\...................\Process-SynthesisOnly-DESUT_VERILOG

....\...\.......\...\...\............\...................\Process-SynthesisOnly-DESUT_VERILOG_StrTbl

....\...\.......\...\...\............\...................\Process-SynthesisOnly-_StrTbl

....\...\.......\...\...\............\...................\Source-BehavioralSim-AutoCompile

....\...\.......\...\...\............\...................\Source-BehavioralSim-AutoCompile_StrTbl

....\...\.......\...\...\............\...................\Source-SynthesisOnly-AutoCompile

....\...\.......\...\...\............\...................\Source-SynthesisOnly-AutoCompile_StrTbl

....\...\.......\...\...\............\xreport\Gc_RvReportViewer-Current-Module

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Current-Module_StrTbl

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Module-Data-csa

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Module-Data-csa_StrTbl

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Module-Data-modcsa

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Module-Data-modcsa_StrTbl

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Module-DataFactory-Default

....\...\.......\...\...\............\.......\Gc_RvReportViewer-Module-DataFactory-Default_StrTbl

....\...\.......\...\...\..REGISTRY__\Autonym\regkeys

....\...\.......\...\...\............\bitgen\regkeys

....\...\.......\...\...\............\...init\regkeys

....\...\.......\...\...\............\common\regkeys

....\...\.......\...\...\............\.pldfit\regkeys

....\...\.......\...\...\............\dumpngdio\regkeys

....\...\.......\...\...\............\fuse\regkeys

....\...\.......\...\...\............\HierarchicalDesign\HDProject\regkeys

....\...\.......\...\...\............\hprep6\regkeys

....\...\.......\...\...\............\idem\regkeys

....\...\.......\...\...\............\libgen\regkeys

....\...\.......\...\...\............\map\regkeys

....\...\.......\...\...\............\netgen\regkeys

....\...\.......\...\...\............\.gc2edif\regkeys

....\...\.......\...\...\............\...build\regkeys

....\...\.......\...\...\............\..dbuild\regkeys

....\...\.

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