文件名称:Lab17_seq_detect
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一个序列检测器，在时钟的每个下降沿检查数据。当检测到输入序列 din 中出现 1101 或 0110时，输出 flag 为 1，否则输出为 0。 （1）当cs = 1，wr 信号由低变高（上升沿）时，din 上的数据将写入由 addr 所指定的存储单元
（2）当cs = 1，rd = 0时，由 addr 所指定的存储单元的内容将从 dout 的数据线上输出。 -A sequence detector, check the data in each clock falling edge. When the din of detection to the input sequence is a 1101 or 0110, the output flag is 1, otherwise the output is 0.
（2）当cs = 1，rd = 0时，由 addr 所指定的存储单元的内容将从 dout 的数据线上输出。 -A sequence detector, check the data in each clock falling edge. When the din of detection to the input sequence is a 1101 or 0110, the output flag is 1, otherwise the output is 0.
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fsm_fsm.v
seq_detect.v
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seq_detect.v
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