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文件名称:CLK_3DIV

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 41kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • w**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

分频模块的设计 三分频 要求占空比为50-The design of the module frequency division three points of frequency requirements than empty for 50


(系统自动生成,下载前可以参看下载内容)

下载文件列表

CLK_3DIV\CLK_3DIV.asm.rpt

........\CLK_3DIV.done

........\CLK_3DIV.fit.rpt

........\CLK_3DIV.fit.smsg

........\CLK_3DIV.fit.summary

........\CLK_3DIV.flow.rpt

........\CLK_3DIV.map.rpt

........\CLK_3DIV.map.smsg

........\CLK_3DIV.map.summary

........\CLK_3DIV.pin

........\CLK_3DIV.pof

........\CLK_3DIV.qpf

........\CLK_3DIV.qsf

........\CLK_3DIV.qws

........\CLK_3DIV.sim.rpt

........\CLK_3DIV.sof

........\CLK_3DIV.tan.rpt

........\CLK_3DIV.tan.summary

........\CLK_3DIV.v

........\CLK_3DIV.vwf

........\CLK_3DIV_assignment_defaults.qdf

........\db\CLK_3DIV.db_info

........\..\CLK_3DIV.eco.cdb

........\..\CLK_3DIV.sim.vwf

........\..\CLK_3DIV.sld_design_entry.sci

........\..\wed.zsf

........\db

CLK_3DIV

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