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文件名称:verilog1602

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 8kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • h**
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  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
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如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

终于搞定了这个lcd液晶显示的程序，净是犯些不该犯的错误，还本人找了那么久，先是仿真查了所有时钟信号，又查了lcd_rs和lcd_rw，都没有错-Finally fix the LCD program, clean is a hideous make some stupid mistakes, I look for so long, the first looked up all the clock signal, and checked lcd_rs and lcd_rw, all not wrong
(系统自动生成,下载前可以参看下载内容)

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verilog1602.doc

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