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文件名称:e011_timingdesigner

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 29.68mb
  • 下载次数：
  • 0次
  • 提 供 者：
  • xu***
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  • 无
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失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

FPGA时序设计时必备的软件。可以有效的提高逻辑设计的速度，调整设计时的时序。-FPGA design timing necessary software. Logic design can effectively improve the speed of adjustment of the design timing.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

timing designer keygen.rar

td.win32.7030.zip

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