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文件名称:Full_adder

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 4kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • D***
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VHDL新手入门：全加器的实现及仿真，输入量为两个不同频时钟-VHDL Getting Started: full adder implementation and simulation, input clock frequency for the two different
(系统自动生成,下载前可以参看下载内容)

下载文件列表

db\Full_adder.db_info

..\Full_adder.eco.cdb

..\Full_adder.sld_design_entry.sci

Full_adder.qpf

Full_adder.qsf

Full_adder.qws

Full_adder.vhd

Full_adder.vhd.bak

db

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