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文件名称:VHDLclokedisplaycounter

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 10kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • q***
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

基于秒表改换的测频率计，分为三个项目立化，分别为计算、时钟、显示。用于FPGA试验台-Change based on the measured frequency meter stopwatch, set of three projects, namely, computing, clock, display.
(系统自动生成,下载前可以参看下载内容)

下载文件列表

VHDL语言由秒表改计频计的源程序代码\显示部分.doc

..................................\主程序及计算部分.doc

..................................\时钟部分.doc

VHDL语言由秒表改计频计的源程序代码

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