文件名称:dds
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用Verilog语言实现基于dds技术的余弦信号发生器，其输出位宽为16比特-Dds with the Verilog language technology based on the cosine signal generator, the output bit width is 16 bits
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下载文件列表
dds\dds.v
...\rom_cos.coe
...\rom_cose.xco
...\rom_sin.coe
...\rom_sine.xco
...\transcript
dds
...\rom_cos.coe
...\rom_cose.xco
...\rom_sin.coe
...\rom_sine.xco
...\transcript
dds