文件名称:fadd16
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实验用16位全加器的VHDL代码,适合初学者学习,数电学习的好工具。
-Experiment with 16-bit full adder VHDL code for beginners to learn, a good tool to learn a few power.
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(系统自动生成,下载前可以参看下载内容)
下载文件列表
16位全加器\16位全加器.qpf
..........\16位全加器.qsf
..........\db\16位全加器.db_info
..........\..\prev_cmp_16位全加器.qmsg
..........\..\16位全加器.sld_design_entry.sci
..........\16位全加器.vhd
..........\16位全加器.qws
..........\db
16位全加器
..........\16位全加器.qsf
..........\db\16位全加器.db_info
..........\..\prev_cmp_16位全加器.qmsg
..........\..\16位全加器.sld_design_entry.sci
..........\16位全加器.vhd
..........\16位全加器.qws
..........\db
16位全加器