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文件名称:state_mm

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 王**
  • 相关连接：
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修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

有限状态机源码，verilog语言编写。非常详细的示范了FSM状态机的编写。-Finite state machine source code, verilog language. A very detailed model of the FSM state machine preparation.
相关搜索： 有限状态机
系统设计

(系统自动生成,下载前可以参看下载内容)

下载文件列表

state_mm.v

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