文件名称:projiect
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简单数字系统的系统级设计，完成E1clk 时钟1/32 分频产生64K 时钟的设计-A simple system-level design of digital systems to complete E1clk clock 1/32 min 64K clock frequency generated design
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下载文件列表
projiect\描述.pdf
........\时钟分频\Clk_64K.v
........\........\Clk_64k.vwf
........\测试一\test04_1.v
........\......\test04_1.vwf
........\....二\test04_2.sof
........\......\test04_2.v
........\......\test04_2.vwf
........\时钟分频
........\测试一
........\测试二
projiect
........\时钟分频\Clk_64K.v
........\........\Clk_64k.vwf
........\测试一\test04_1.v
........\......\test04_1.vwf
........\....二\test04_2.sof
........\......\test04_2.v
........\......\test04_2.vwf
........\时钟分频
........\测试一
........\测试二
projiect