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文件名称:0917afifo_s

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 3kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 范**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

采用同步异步信号的方式，将两个CLK统一到同一个时钟下工作，用同步FIFO实现异步FIFO-Asynchronous signals using synchronous way, two a clock CLK to the same uniform to work, using synchronous FIFO Asynchronous FIFO
(系统自动生成,下载前可以参看下载内容)

下载文件列表

0917afifo_s\AFIFO_TOP.v

...........\Data_TransAndDFFsyns.v

...........\DPRAM.v

...........\MCU.v

0917afifo_s

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