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说明:16-bit数的偶数奇偶校验及阶乘运算,用verilog写-16-bit number of even parity and factorial computation, written using Verilog<杨艳 > 在 2024-11-08 上传 | 大小:1kb | 下载:0
[VHDL编程] 微处理机接口电路设计
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[VHDL编程] 8051IP 核源代码(VHDL)
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[VHDL编程] random data gen(vhdl)
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[VHDL编程] vhdlvlogcompared
说明:VHDL与Verilog的比较-VHDL and Verilog comparison<谢帆> 在 2024-11-08 上传 | 大小:39kb | 下载:0