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[VHDL编程EP1C6Q240C6

说明:altera EP1C6Q240C6开发板原理图-altera EP1C6Q240C6 SCH
<sct_sct> 在 2024-11-19 上传 | 大小:67kb | 下载:0

[VHDL编程Cyclone1C20Nios

说明:ALTERA Cyclone1C20 Nios开发板,protel99格式-ALTERA Cyclone1C20 Nios,protel99
<sct_sct> 在 2024-11-19 上传 | 大小:75kb | 下载:0

[VHDL编程Micron_SDRAM_DDR2Simulation_model_Verilog

说明:DDR2 SDRAM仿真模型,适合于ModelSim下工作,请先阅读readme-DDR2 SDRAM Simulation Model which is suitable for modelsim. Please read readme file firstly.
<rar> 在 2024-11-19 上传 | 大小:20kb | 下载:0

[VHDL编程HwLog10

说明:用verilog写的,基于查表法实现的LOG10运算器,在Altera FPGA中应用。-It is a verilog design of LOG10 calculation unit, which is based on LUT arithmatic. And it is applicated in Altera FPGA.
<vincent> 在 2024-11-19 上传 | 大小:13kb | 下载:0

[VHDL编程Turbo

说明:基于fpga的交织编码器设计,主要讲叙如何在fpga上实现交织编码器。-something about turbo。
<xixi> 在 2024-11-19 上传 | 大小:1.75mb | 下载:0

[VHDL编程VHDL

说明:VHDL实现快速傅立叶变换 -VHDL implementation VHDL implementation of Fast Fourier Transform Fast Fourier Transform
<jingzi> 在 2024-11-19 上传 | 大小:61kb | 下载:0

[VHDL编程CPLD-CRACK-SIEMENS-200PLC

说明:可用来破解分析西门子200 PLC与模块的通讯协议,基于ALTERA CPLD EPM240的设计. 需要配合分析板配套使用。-Analysis can be used to crack the Siemens 200 PLC and the communication protocol modules, based on the ALTERA CPLD EPM240 design. The need to tie in wi
<wuzhen> 在 2024-11-19 上传 | 大小:2kb | 下载:2

[VHDL编程UARTCODE

说明:一个有关于UART开发的自己的一个VHDL代码-A UART has developed its own about a VHDL code
<sy> 在 2024-11-19 上传 | 大小:4kb | 下载:0

[VHDL编程DDRSDRAM

说明:DDR SDRAM的资料,有兴趣的朋友可以下下来-DDR SDRAM information, interested to see friends down under
<sy> 在 2024-11-19 上传 | 大小:72kb | 下载:0

[VHDL编程ddsdds

说明:直接数字频率合成,可以直接输出所需要的波形-Direct digital synthesizer, you can direct output of the waveform required
<wqq> 在 2024-11-19 上传 | 大小:1.54mb | 下载:0

[VHDL编程jishiqi

说明:利用数字电路知识,进行二十四小时计时,并有闹钟与蜂鸣器功能-Knowledge of the use of digital circuits, the 24 hours time, and there is an alarm clock function and buzzer
<wqq> 在 2024-11-19 上传 | 大小:338kb | 下载:0

[VHDL编程PrimeTime_STA

说明:PrimeTime Intro to STA -PrimeTime Intro to STA
<xiantongma> 在 2024-11-19 上传 | 大小:8.71mb | 下载:0
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