[VHDL编程] Four-controllable-counter

说明：功能是（用Verilog语言的，内有比较详细的注释）： （1）计数器的功能是从0到9999计数，并能以十进制数的形式在七段数码管上显示出来(包括七段数码管显示模块). （2）该计数器有一个1个nclr和一个adj_plus端，在控制信号的作用下（见下表），计数器具有复位、增或减计数、暂停的功能。编写以上的程序的完整模块. 计数器的功能表 nclr adj_minus 功 能 0 0 复位为0 0 1 递增计数
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[VHDL编程] FPGA

说明：FPGA最小系统的概念组成电路、常用接口和硬件系统的调试-The concept of minimum system composed of FPGA circuits, common interface and hardware system debugging
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[VHDL编程] vga_top

说明：VGA测试程序顶层文件，为视频信号的处理提供框架-Top-level test program files VGA, for video signal processing to provide a fr a mework
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[VHDL编程] vga_sync

说明：显示器控制程序，控制显示器的场同步和行同步-Display control program to control the display of the vertical sync and horizontal sync
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[VHDL编程] USB

说明：这个是Verilog的USB控制程序，用于USB与FPGA之间的通信-This is the USB Verilog control procedures for the communication between USB and FPGA
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[VHDL编程] ADV7125

说明：ADV7125在FPGA上的驱动程序，为用户提供ADV7125的控制接口-ADV7125 driver on the FPGA, to provide users with the control interface ADV7125
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[VHDL编程] allot1_4

说明：设计一个双1路到4路的数据分配器电路 设计要求： （1）1路到4路数据分配器其逻辑功能表如表3.2.2所示，试用行为描述方式写出设计块对其逻辑功能进行描述。 表3.2.2 数据分配器功能表 S1 S0 Out0 Out1 Out2 Out3 0 0 in z z z 0 1 z In Z Z 1 0 Z Z In z 1 1 Z Z Z in-1 way to design a dual 4-way d
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[VHDL编程] AIC23IP

说明：AIC23的IP核，提供ＮＩＯＳ　ＣＰＵ与FPGA 的通信方式-AIC23' s IP core, providing NIOS CPU means of communication with the FPGA
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[VHDL编程] double_mux4_1

说明：设计一个双四选一的数据选择器电路 设计要求： （1）双四选一的数据选择器的电路框图如图3.2.3所示，试写出设计块对其逻辑功能进行描述。 -Choose a design of a dual quad data selector circuit design requirements: (1) a double four selected data selector circuit diagram shown in
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[VHDL编程] kcpsm3

说明：code for Kcpsm3 with VhDL code...write for programers to improve their programation usin picoblaze and generating a easier code than VHDL-code for Kcpsm3 with VhDL code...write for programers to improve their programatio
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[VHDL编程] 2_intro_fpga

说明：Introduction to FPGA presentations
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[VHDL编程] curso-fpga-programacion-arreglos-compuertas

说明：cpuse to learn how to programate VHDL
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