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[VHDL编程reload_fir

说明:这是我在Xilinx公司的FPGA上实现的FIR滤波器,调用的内部核,其特色是可以用较少的资源实现该功能,而且可以实现参数重载,即从外部MCU设置FIR滤波器的参数-This is my Xilinx FPGA to achieve the FIR filter, called internal audit, its characteristics can be achieved with fewer resources to thi
<林寒风> 在 2024-12-26 上传 | 大小:15.95mb | 下载:0

[VHDL编程singnalandsystem(zhengjunli)

说明:信号与系统(郑君里第二版) 傅式变换,拉式变化,FFT-signal and system
<feifei> 在 2024-12-26 上传 | 大小:15.94mb | 下载:0

[VHDL编程sdh_doc

说明:韦乐平老师的全本《光同步数字传输网》,PDF格式,很清晰。-Wei Leping all the teachers, " Synchronous Digital Transmission Network" , PDF format, is very clear.
<李志> 在 2024-12-26 上传 | 大小:15.94mb | 下载:0

[VHDL编程FPGA-Prototyping-by-VHDL-Examples---Xilinx-Sparta

说明:FPGA prototyping by VHDL examples include FIFO,RAM,ROM,filters, registers and others-FPGA prototyping by VHDL examples include FIFO,RAM,ROM,filters, registers and others
<Aleks> 在 2024-12-26 上传 | 大小:15.85mb | 下载:0

[VHDL编程Timing-analysis

说明:FPGA玩转Altera之时序篇,包括时序分析注意事项-Altera play the FPGA XuPian, including timing analysis the matters needing attention
<蔡历鑫> 在 2024-12-26 上传 | 大小:15.97mb | 下载:0

[VHDL编程Basic_Nios

说明:This starter kit is for developing embedded system in FPGAs using NIOS.
<elisa> 在 2024-12-26 上传 | 大小:15.94mb | 下载:0

[VHDL编程Nios_SDRAM

说明:在Nios上搭建平台,使用SDRAM作内存,并用VGA显示图像-A platform on the Nios SDRAM for memory, and VGA display image
<彭娟娟> 在 2024-12-26 上传 | 大小:15.91mb | 下载:0

[VHDL编程dvi_output

说明:DVI output modelsim simulation
<peter> 在 2024-12-26 上传 | 大小:15.95mb | 下载:0

[VHDL编程FPGA

说明:fpga实现图像的变换,图像旋转放大-fpga implementation image transform, image rotation and magnification
<xieruihong> 在 2024-12-26 上传 | 大小:15.89mb | 下载:0

[VHDL编程fpgahdl_xilinx-edk.tar

说明:xilinx zynq 7000 FPGA demo-xilinx zynq 7000 FPGA demo
<xujin2002ji> 在 2024-12-26 上传 | 大小:15.85mb | 下载:0

[VHDL编程DE0_development_board_cd_data

说明:这是DE0开发板的光盘资料,是友晶公司的关于altera公司的Cyclone III开发板。-This is DE0 development board disc material, is friend chip of altera company Cyclone III development board.
<吴超> 在 2024-12-26 上传 | 大小:15.89mb | 下载:0

[VHDL编程IIR-FPGA

说明:基于FPGA实现IIR滤波器的程序,用VERILOG编程语言实现-The program based on the FPGA implementation of the IIR filter is implemented in the VERILOG programming language
<刘华> 在 2024-12-26 上传 | 大小:15.96mb | 下载:0
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