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[VHDL编程基于Altera FPGACPLD的电子系统设计及工程实践

说明:基于Altera FPGACPLD的电子系统设计及工程实践
<wendy0518> 在 2010-11-13 上传 | 大小:26mb | 下载:0

[VHDL编程MTDB_SYSTEM_CD_V1.0

说明:ALTERA Nios II Embedded Evaluation Kit开发板制造商(terasic)提供的多媒体显示板(Terasic Multimedia Touch Panel Daughter Board (MTDB))扩展开发包。 里为有两个开源的例子 1.MTDB_SD_Card_Audio,从SD卡中读取WAV文件然后通过DA播放,这个对不SD Card的初学者非常的有用,可以知道使用FPGA SPI
<myfingerhurt> 在 2024-11-08 上传 | 大小:26.19mb | 下载:0

[VHDL编程ALTERA@FPGA@example

说明:基于ALTERA的几个VHDL实例,如FPGA单片机,DDS的正弦信号发生器,FPGA视频监控-VHDL example:such as DDS Sine signal generator
<bin> 在 2024-11-08 上传 | 大小:25.98mb | 下载:0

[VHDL编程EDA

说明:fpga应用,eda设计和应用,基于VHDL语言的设计仿真。-fpga applications, eda design and application, based on VHDL design simulation.
<邹平> 在 2024-11-08 上传 | 大小:26.22mb | 下载:0

[VHDL编程DAC900

说明:自己写的,FPGA为Cyclone ep1c12q240c8,dac芯片是DAC900。fpga内置ram存储波形数据,发送给dac900产生波形。用VerilogHDL编写。-Write your own, FPGA as Cyclone ep1c12q240c8, dac chip is DAC900. Built-ram fpga store waveform data, waveform generated is sent to
<xiexin> 在 2024-11-08 上传 | 大小:26.17mb | 下载:0

[VHDL编程lisa-vhdl2va

说明:通过modelsim仿真检测matlab生成滤波器效果。-Generate the filter through matlab and simulated by modelsim.
<andy> 在 2024-11-08 上传 | 大小:26.13mb | 下载:0

[VHDL编程MY_CAMARA_3_18_FIFO

说明:基于QUARTUS集成环境开发的IP核,能够读取数据,并将其显示在数码管上-the IP core of fpga,can be used in embedded device
<刘普明> 在 2024-11-08 上传 | 大小:26.53mb | 下载:0

[VHDL编程FPGA-based-image-median-filtering

说明:基于FPGA的图像中值滤波,在xilinx的FPGA上实现了算法,采用matlab的算法最终通过了验证。-FPGA-based image median filtering on xilinx FPGA implementation of the algorithm, using matlab algorithm finally passed validation.
<lushusho> 在 2024-11-08 上传 | 大小:26.42mb | 下载:0

[VHDL编程INT

说明:基于FPGA的nios ii嵌入式中断应用开发程序,仅供参考学习使用,谢谢。-NIOS based on the II FPGA embedded interrupt application development process, only for reference learning to use, thank you.
<宁静> 在 2024-11-08 上传 | 大小:26.34mb | 下载:0

[VHDL编程Uart_Gray_Display

说明:Uart_Gray_Display---- 基于fpga的图像处理(Uart_Gray_Display---- based on image processing FPGA)
<布列塔尼> 在 2024-11-08 上传 | 大小:26.53mb | 下载:0

[VHDL编程exp_fft_test_724

说明:在quartus软件中调用FFT的IP核,编辑IP核的驱动模块,使得IP核读入数据进行处理,输出数据。使用modelsim进行联合仿真。(In the quartus software, the IP kernel of FFT is called, and the driver module of the IP kernel is edited, so that the IP kernel is read into the data
<XHF72> 在 2024-11-08 上传 | 大小:26.28mb | 下载:0

[VHDL编程zcu102_exp_1

说明:给予Xilinx系列zcu102开发板,完成了一个基本的project,实现了PS 端对PL 端的控制,并在PL端自己生成IP,是初学者很好的学习模板。(Xilinx series zcu102 development board, completed a basic project, the PS end to the PL control, and the PL end of the generation of IP, is a g
<ICwxforever> 在 2024-11-08 上传 | 大小:26.12mb | 下载:0
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