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[VHDL编程] sine-generator
说明:原创:采用VHDL语言编写的正弦信号发生器。rom采用quartus自带的lpm生成,可产生正弦波。更改rom内容可改变波形-Original: Using VHDL languages sinusoidal signal generator. rom using Quartus LPM s own generation, can produce sine wave. Rom content changes can change the<zzwuyu> 在 2025-02-23 上传 | 大小:660kb | 下载:0
[VHDL编程] AD7656_Tri
说明:触发AD7656进行双路采样的触发控制模块 内附QUARTUS生成的bsf文件-AD7656 Dual Trigger to trigger the control module sample included QUARTUS generated bsf file<阿飞> 在 2025-02-23 上传 | 大小:660kb | 下载:0
[VHDL编程] ProjectreportOFDMTXRX
说明:OFDM implementation in VHDL/<Ammankumar> 在 2025-02-23 上传 | 大小:660kb | 下载:0
[VHDL编程] LIP6921CORE_decss
说明:Encry Decry DECESS verilog code<jc> 在 2025-02-23 上传 | 大小:660kb | 下载:0
[VHDL编程] picoblaze_pwm_control
说明:基于Xilinx的8位软核PicoBlaze的Pwm设计,采用汇编语言设计。使用软件模拟spi接口-Based on the Xilinx PicoBlaze soft-core 8-bit design of Pwm, using assembly language design. Spi interface with software simulation<扑天雕> 在 2025-02-23 上传 | 大小:660kb | 下载:0
[VHDL编程] verilog-course-design
说明:两个关于Verilog语言学习的课程设计,有要求、思路和代码,一个是芯片接口设计,一个是智能烧烤机设计-Two on the Verilog language learning course design, requirements, ideas and code, a chip interface design, a smart barbecue machine design<张驰> 在 2025-02-23 上传 | 大小:661kb | 下载:0
[VHDL编程] FPGA_Uart
说明:FPGA程序,verilog HDL语言编写,包含AD转换和串口发送程序,由于AD芯片种类繁多时序迥异,故主要参考串口发送程序。本程序使用quartus ii 13.0 编写。-FPGA procedures, verilog HDL language, includes an AD converter and serial transmission program, since a wide range of AD chip timi<suchenguang> 在 2025-02-23 上传 | 大小:661kb | 下载:0