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[VHDL编程] modelsim_howto
说明:modelsim的使用方法,modelsim 是VHDL的仿真工具-how to use modelsim<siva> 在 2025-04-19 上传 | 大小:1.19mb | 下载:0
[VHDL编程] dp_test
说明:本程序是用VHDL语言编写的,其中包括并口通讯,DDS电机调速,编码器信号处理等,对研究这方面的工程人员有一定参考作用-This procedure is used VHDL language, including the parallel port communication, DDS motor, encoder signal processing and so on, to look at this area of enginee<maolianghu> 在 2025-04-19 上传 | 大小:588kb | 下载:0