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[VHDL编程freqdivfinal

说明:用vhdl实现的分频器,可产生任意对主时钟的分频,从而是实现不同频率pwm的控制-Achieved using VHDL divider can produce any of the sub-master clock frequency, thereby achieving different frequency pwm control
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[VHDL编程countertest

说明:vhdl实现的计数器 -VHDL realization counter
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[VHDL编程reverse

说明:vhdl实现对直流电机的控制 -VHDL realization of DC motor control
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[VHDL编程vedio

说明:VHDL设计的高速图像采集模块源码,离散余弦变换,图像压缩与编码源码-VHDL design of high-speed image acquisition module source, discrete cosine transform, image compression and encoding source
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[VHDL编程gal_16v8

说明:基于GAL16V8D的一个时钟整开逻辑代码.Verilog编写!-GAL16V8D based on a clock the whole logic of the code to open. Verilog prepared!
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[VHDL编程I2C

说明:I2C总线的逻辑代码.Verilog编写!很好用.调试成功.-I2C bus logic code. Verilog prepared! Good use. Debugging success.
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[VHDL编程Oscillograph

说明:在EP1C6Q240上实现示波器的逻辑代码.Verilog编写!很好用.调试成功.-Oscilloscopes EP1C6Q240 achieved in the logic of code. Verilog prepared! Good use. Debugging success.
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[VHDL编程reset

说明:异步复位同步释放的复位信号处理逻辑代码.Verilog编写!很好用.在EP1C6Q240上调试成功.-Asynchronous Reset release synchronous reset signal processing logic code. Verilog prepared! Good use. EP1C6Q240 debugging in the success.
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[VHDL编程SD_W_R

说明:SD卡读写源代码.用Verilog编写.很不错.值得借鉴.特别对SD卡开发的人员!-SD card reader-writer source code. Prepared to use Verilog. Is pretty good. Be used for reference. In particular, the development of personnel SD card!
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[VHDL编程arbiter

说明:VHDL源代码共享,资源多多共享,论坛上多多讨论!-VHDL source code sharing, sharing of resources a lot, a lot of discussion forums!
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[VHDL编程ram_dp_sr_sw

说明:VHDL源代码,资源多多共享,不懂的地方多多指教-VHDL source code, resources, a lot of sharing, do not know where the exhibitions
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[VHDL编程ram_sp_ar_aw

说明:VHDL源代码,资源多多共享,不懂的地方多多指教-VHDL source code, resources, a lot of sharing, do not know where the exhibitions
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