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[VHDL编程DDR3_A4

说明:xilinx FPGA A7 驱动DDR3的DEMO例程(DEMO routines driven by Xilinx FPGA A7 for DDR3)
<amzhy8> 在 2024-11-13 上传 | 大小:23.23mb | 下载:0

[VHDL编程I2C

说明:xilinx FPGA驱动IIC例程DEMO(A IIC driver demo of xilinx FPGA with verilog)
<amzhy8> 在 2024-11-13 上传 | 大小:3.14mb | 下载:0

[VHDL编程EEPROM

说明:xilinx fpga 读写eeprom例程(Xilinx FPGA read and write EEPROM routine)
<amzhy8> 在 2024-11-13 上传 | 大小:54kb | 下载:0

[VHDL编程XADC

说明:xilinx verilog FPGA驱动AD9613 数据采集DEMO程序(Xilinx Verilog FPGA drives AD9613 data acquisition DEMO program.)
<amzhy8> 在 2024-11-13 上传 | 大小:775kb | 下载:0

[VHDL编程友晶Sdram_Control_4Port

说明:sdram控制器,基础资料以及常用芯片手册(some article about sdram controller, basic datasheet)
<sanjn> 在 2024-11-13 上传 | 大小:17kb | 下载:0

[VHDL编程ug585-Zynq-7000-TRM

说明:Xilinx Zynq 7000 参考文档(Xilinx Zynq 7000 Reference documents)
<MarioCrane> 在 2024-11-13 上传 | 大小:13.54mb | 下载:0

[VHDL编程crc_nguyenquanicd

说明:design crc module in data network transmission
<Zick> 在 2024-11-13 上传 | 大小:2kb | 下载:0

[VHDL编程Audio_whistle_suppressor

说明:探讨了一种数字移频法啸叫检测与抑制音频功率放大实验测试系统设计方案,用来实现带啸叫检测与抑制音频功率放大.系统以 FPGA 为控制核心(This paper has designed a testing system for an audio power amplifier with howling detection and suppression which is used to achieve howling detection
<Justin小强子> 在 2024-11-13 上传 | 大小:19.55mb | 下载:0

[VHDL编程USER

说明:测试实验部分程序,GSM模块的程序设计,附加的(Test experiment part program, program design of GSM module.)
<面朝大海09> 在 2024-11-13 上传 | 大小:94kb | 下载:0

[VHDL编程class_experiment_elective_5

说明:写了一个常用的楼梯灯的例程,楼下到楼上依次有 3 个感应灯:灯 1、灯 2、灯 3。当行人上下楼梯时,各个灯感应到后自 动点亮,若在 8s 内感应信号消失,则点亮 8s,若感应信号存在时间超过 8s,则感应信号消 失 4s 后灯自动关闭。 任务 1:做出如上逻辑电路设计并仿真; 任务 2:考虑去抖,对于感应信号到达存在毛刺(小于 0.5s),设计逻辑并剔出。 任务 3:若为节约能源,下一个灯点亮的同时将自动关闭上一个灯,做出如
<后天夜间> 在 2024-11-13 上传 | 大小:1kb | 下载:0

[VHDL编程chuanbing

说明:此程序利用vhdl硬件描述语言在quartus平台上成功编译实现了串并转换功能。(This program successfully compiled and implemented serial and parallel conversion functions on the quartus platform by using VHDL hardware descr iption language.)
<魅才林亚奇> 在 2024-11-13 上传 | 大小:343kb | 下载:0

[VHDL编程Quartus按键去抖动程序

说明:Verilog语言编写的按键去抖动模块demo(Key debounce module demo written in Verilog language)
<Wolfalone> 在 2024-11-13 上传 | 大小:4kb | 下载:0
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