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[VHDL编程] ldpc_decoder_802_3an_latest.tar
说明:802.3an ldpc decoder verilog 源码<杨振飞> 在 2025-02-08 上传 | 大小:864kb | 下载:0
[VHDL编程] 4_bit_parallel_add-sub
说明:4 bit parallel add-sub with test bench.. in vhdl-4 bit parallel add-sub with test bench.. in vhdl..<harkirat> 在 2025-02-08 上传 | 大小:1kb | 下载:0
[VHDL编程] asyn_counter
说明:async counter,, test bench included-async counter,, test bench included..<harkirat> 在 2025-02-08 上传 | 大小:1kb | 下载:0
[VHDL编程] async_FlipFlop
说明:asynchronous D-FlipFlop & JK-FlipFlop.. with test bench.<harkirat> 在 2025-02-08 上传 | 大小:2kb | 下载:0
[VHDL编程] ddr_sdr_V1_1
说明:DDR控制器 - 用XILINX Virtex II FPGA实现 - 使用DDR MT46V16M16作为仿真模型 - 通用化-DR SDRAM Controller Core - has been designed for use in XILINX Virtex II FPGAs - works with DDR SDRAM Device MT46V16M16 without changes -<jordanliang> 在 2025-02-08 上传 | 大小:37kb | 下载:0