[VHDL编程] 11

说明：VHDL出租车计费器设计，课程设计完美通过优秀,文档内容是该课程设计的论文，里面详细介绍了该设计的实现和各个模块的具体实现细节，这是河南科技大学课程设计内容-Taxi meter VHDL design, curriculum design the perfect through the excellent content of the document is that the curriculum design papers, whi
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[VHDL编程] 22

说明：VHDL出租车计费器设计论文文档，word格式，内容详细，介绍完整，功能强大。-Taxi meter VHDL design paper documents, word format, detailed descr iption complete and powerful.
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[VHDL编程] ALU

说明：Verilog编写的ALU，可实现数学、移位、逻辑运算-ALU Verilog prepared, enabling mathematics, shift, logical operations
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[VHDL编程] counter

说明：Verilog语言编写的8进制同步、异步加法计数器-Verilog language octal synchronous, asynchronous addition counter
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[VHDL编程] fsm

说明：verilog语言，有限状态机实现的序列检测器-verilog language, finite state machine sequence detector
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[VHDL编程] bits

说明：verilog语言，移位寄存器实现的序列检测器-verilog language, to achieve the shift register sequence detector
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[VHDL编程] freq

说明：verilog 编写的频率计 管脚绑定支持Xilinx Spartan6-verilog prepared frequency meter pin binding support Xilinx Spartan6
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[VHDL编程] sata_phy_latest.tar

说明：用verilog写成的sata2的phy物理层，可应用与sata2的控制层下层接口！-Phy written by verilog sata2 the physical layer, the lower layer can be applied to the interface control layer and sata2!
<hezigang> 在 2024-11-19 上传 | 大小：378kb | 下载：0

[VHDL编程] szz

说明：基于CPLD的数字钟，用VHDL语言编写，数码管显示，可调时调分，具有整点报时功能。-CPLD-based digital clock, using VHDL language, the digital display, an adjustable transfer points, the whole point timekeeping function.
<李襄> 在 2024-11-19 上传 | 大小：287kb | 下载：0

[VHDL编程] Digital-dynamic-display-FPGA

说明：数码管动态显示 FPGA verilog 基本例程-Digital dynamic display FPGA
<zhouxiao> 在 2024-11-19 上传 | 大小：438kb | 下载：0

[VHDL编程] FPGA-PWM_LED

说明：FPGA 实现PWM控制LED的例程 具有参考意义-FPGA to achieve LED PWM control routine
<zhouxiao> 在 2024-11-19 上传 | 大小：429kb | 下载：0

[VHDL编程] des

说明：des algorithm Simple
<kalyan> 在 2024-11-19 上传 | 大小：109kb | 下载：0