[VHDL编程] LEDWATER

说明：用verilog hdl 实现LED流水灯实验，能改变间隔周期和循环时间。-led water
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[VHDL编程] s2p

说明：用硬件描述语言verilog hdl 写的串行转并行代码。-convert serial to parallel
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[VHDL编程] scan_led

说明：用硬件描述语言verilog hdl写的实现动态扫描显示的代码。-Using Hardware Descr iption Language Verilog HDL written to achieve dynamic scanning display code.
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[VHDL编程] syncfifo

说明：一个简单的基于single port ram 的同步fifo。只能支持只写或只读。-A simple single port ram based on the synchronization fifo. Can only support write-only or read-only.
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[VHDL编程] LCD12864

说明：lcd12864的中文显示。可以通过查询ACSII码进行更改。-Lcd12864 Chinese display. You can change the code by querying ASCII.
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[VHDL编程] VGA

说明：用verilog编写的vga显示colorbar图像。包含VGA驱动程序，分辨率为640*480.-Vga with verilog display colorbar image. Includes VGA driver with a resolution of 640* 480.
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[VHDL编程] Butterfly_lovers_beef

说明：verilog编写的蜂鸣器音乐《梁山伯与祝英台》。系统时钟为50MHz。-Verilog prepared buzzer music Butterfly Lovers . The system clock is 50MHz.
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[VHDL编程] async_fifo

说明：用verilog编写的简单异步fifo。可以给初学者用来学习fifo的初步工作原理。（不能直接使用。）-Verilog prepared by the simple asynchronous fifo. Can be used for beginners to learn fifo the initial working principle. (Can not be used directly.)
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[VHDL编程] pwm_generate_module

说明：verilog编写的，用按键控制PWM波占空比。可以定义死区，用来控制舵机或者led灯的亮暗。-Verilog prepared, with the button to control the PWM wave duty cycle. You can define the dead zone, used to control the steering gear or led lights bright and dark.
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[VHDL编程] cla_16bit

说明：verilog 16bit carry lookahead adder-verilog 16bit carry lookahead adder
<uiop7890> 在 2024-11-13 上传 | 大小：1kb | 下载：0

[其他嵌入式/单片机内容] ADC_of_MSP430F249

说明：A single sample is made on A10 with reference to internal 1.5V Vref. Software sets ADC12SC to start sample and conversion - ADC12SC automatically cleared at EOC. ADC12 internal oscillator times sample and conversio
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[其他嵌入式/单片机内容] TimerA_of_MSPF249

说明：Toggle P1.0 using software and the TA_0 ISR. Timer_A is configured for up mode, thus the timer overflows when TAR counts to CCR0. In this example, CCR0 is loaded with 1000-1. ACLK = TACLK = INCLK = 32768Hz, MCLK =
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