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[单片机(51,AVR,MSP430等)main

说明:采用F2812芯片,c语言如何编写实现50Hz正弦波!-F2812 chip used, c language how to write to achieve 50Hz sine wave!
<戚莫> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[单片机(51,AVR,MSP430等)shuzidianzizhong

说明:单片机实现数字电子钟娴显示,具有调时,分,秒的功能-Single chip digital electronic clock han display, transfer hours, minutes, seconds functions
<情断天涯> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[VHDL编程VHDL

说明:电子设计自动化软件下的3-8位译码器,触发器的VHDL 代码-Electronic design automation software under the 3-8 bit decoder, triggers the VHDL code
<jun> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[单片机(51,AVR,MSP430等)shuzhizhong

说明:数字钟代码,包括原理图和单片机程序代码。原理图为proteus软件仿真的图片-Digital clock code, including schematic and microcontroller code
<gan> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[微处理器(ARM/PowerPC等)main

说明:基于ARM2136芯片的数据采集传输系统-Based on the data collection ARM2136 chip transmission system
<陈亮> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[单片机(51,AVR,MSP430等)DHT11

说明:VERY USEFUL,VERY IMPORTANT,DHT11 DHT 11 DHT11 VERY U SEFUL,VERY IMPORTANT,DHT11 DHT 11 DHT11 -VERY USEFUL,VERY IMPORTANT,DHT11 DHT 11 DHT11 VERY USEFUL,VERY IMPORTANT,DHT11 DHT 11 DHT11 VERY U
<汪志忠> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[VHDL编程shape

说明:滤波器设计,利用中值法完成的梯形滤波的算法,可用于谱仪的滤波器-filter verilog
<帅秀> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[单片机(51,AVR,MSP430等)6179

说明:段码液晶模块的驱动程序,通用于HT1621/CS1621芯片控制的驱动程序。C语言编写的源代码,用51单片机控制。-Segment LCD driver module, common to HT1621/CS1621 chip to control the driver. C language source code, with 51 single-chip control.
<方胜林> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[单片机(51,AVR,MSP430等)AVRyuDIANYA

说明:运用AVR测电压并用显示屏显示,测量电压精度为10位-The use of AVR with the display shows the measured voltage and measured voltage accuracy 10-bit
<zt> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[VHDL编程IPcore_fifo_testbench

说明:我自己写的一个verilog的fifo测试程序,配合xilinx的fifo ip核-I own the fifo write a verilog test procedures, with the fifo ip nuclear xilinx
<张学锋> 在 2024-11-04 上传 | 大小:1024 | 下载:0

[单片机(51,AVR,MSP430等)msp430g2xx1

说明: Timer_A, LED Toggle P1.0, CCR0 Cont. Mode ISR, DCO SMCLK with all MSP430 Value Line. It learn how use Timer and Interrupts with base clock DCO SMCLK.
<kilof> 在 2024-11-04 上传 | 大小:1024 | 下载:1

[VHDL编程hdl-hw1-brent-kung-adder

说明:BRENT KUNG ADDER 4 bits
<dumbmage> 在 2024-11-04 上传 | 大小:1024 | 下载:0
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