文件名称:32_bit_cpu

  • 所属分类:
  • 操作系统开发
  • 资源属性:
  • [Windows] [Visual C] [源码]
  • 上传时间:
  • 2008-10-13
  • 文件大小:
  • 792.73kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 冯*
  • 相关连接:
  • 下载说明:
  • 别用迅雷下载,失败请重下,重下不扣分!

介绍说明--下载内容均来自于网络,请自行研究使用

两条5级的并行流水线,乘法器还有一个简单的中断系统(带一个中断管理的‘操作系统’吧),再加上一个编译器。

主要是说明一下CPU的设计方法,还有一些简单的模块例如加法器,乘法器
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 1786931832_bit_cpu.rar 列表
32位CPU设计\源程序\冒泡排序.txt
32位CPU设计\源程序\冒泡排序2.txt
32位CPU设计\源程序\冒泡排序3.txt
32位CPU设计\源程序\冒泡排序_ex.txt
32位CPU设计\源程序\简单操作系统.txt
32位CPU设计\源程序\选择法排序.txt
32位CPU设计\汇编器相关\Bin2Txt.exe
32位CPU设计\汇编器相关\WASM.exe
32位CPU设计\汇编器相关\首先用WASM编译,然后用Bin2Txt转换.txt
32位CPU设计\汇编器相关\WASM\WASM.dsw
32位CPU设计\汇编器相关\WASM\WASM.ncb
32位CPU设计\汇编器相关\WASM\WASM.opt
32位CPU设计\汇编器相关\WASM\WASM\WASM.CPP
32位CPU设计\汇编器相关\WASM\WASM\WASM.dsp
32位CPU设计\汇编器相关\WASM\WASM\WASM.H
32位CPU设计\汇编器相关\WASM\WASM\WASM.plg
32位CPU设计\汇编器相关\WASM\Bin2Txt\Bin2Txt.cpp
32位CPU设计\汇编器相关\WASM\Bin2Txt\Bin2Txt.dsp
32位CPU设计\汇编器相关\WASM\Bin2Txt\Bin2Txt.plg
32位CPU设计\Super\Adder32.v
32位CPU设计\Super\ALU.v
32位CPU设计\Super\CtrlUnit.v
32位CPU设计\Super\FlagReg.v
32位CPU设计\Super\GET_OPER.v
32位CPU设计\Super\IMME_EX.v
32位CPU设计\Super\INS_DECODER.v
32位CPU设计\Super\IRLoader.v
32位CPU设计\Super\J_PATH.v
32位CPU设计\Super\Mul16.v
32位CPU设计\Super\MUXx1.v
32位CPU设计\Super\Ram.v
32位CPU设计\Super\Reg32.v
32位CPU设计\Super\RegGroup32.v
32位CPU设计\Super\Super.v
32位CPU设计\Super\SysIns.v
32位CPU设计\Super\test.txt
32位CPU设计\Super\指令编码.txt
32位CPU设计\Super\汇编代码.txt
32位CPU设计\Super\说明.txt
32位CPU设计\Super\work\_info
32位CPU设计\Super\work\@to@jmp\verilog.asm
32位CPU设计\Super\work\@to@jmp\_primary.dat
32位CPU设计\Super\work\@to@jmp\_primary.vhd
32位CPU设计\Super\work\@sys@ins@ctrl\verilog.asm
32位CPU设计\Super\work\@sys@ins@ctrl\_primary.dat
32位CPU设计\Super\work\@sys@ins@ctrl\_primary.vhd
32位CPU设计\Super\work\@super@c@p@u\verilog.asm
32位CPU设计\Super\work\@super@c@p@u\_primary.dat
32位CPU设计\Super\work\@super@c@p@u\_primary.vhd
32位CPU设计\Super\work\@shift64_32\verilog.asm
32位CPU设计\Super\work\@shift64_32\_primary.dat
32位CPU设计\Super\work\@shift64_32\_primary.vhd
32位CPU设计\Super\work\@shift32\verilog.asm
32位CPU设计\Super\work\@shift32\_primary.dat
32位CPU设计\Super\work\@shift32\_primary.vhd
32位CPU设计\Super\work\@s@y@s_@i@n@s_@d@e@c@o@d@e@r\verilog.asm
32位CPU设计\Super\work\@s@y@s_@i@n@s_@d@e@c@o@d@e@r\_primary.dat
32位CPU设计\Super\work\@s@y@s_@i@n@s_@d@e@c@o@d@e@r\_primary.vhd
32位CPU设计\Super\work\@reg@group32v3\verilog.asm
32位CPU设计\Super\work\@reg@group32v3\_primary.dat
32位CPU设计\Super\work\@reg@group32v3\_primary.vhd
32位CPU设计\Super\work\@reg@group32v2\verilog.asm
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32位CPU设计\Super\work\@reg@group32v2\_primary.vhd
32位CPU设计\Super\work\@reg@group32\verilog.asm
32位CPU设计\Super\work\@reg@group32\_primary.dat
32位CPU设计\Super\work\@reg@group32\_primary.vhd
32位CPU设计\Super\work\@reg@flag\verilog.asm
32位CPU设计\Super\work\@reg@flag\_primary.dat
32位CPU设计\Super\work\@reg@flag\_primary.vhd
32位CPU设计\Super\work\@reg32v2\verilog.asm
32位CPU设计\Super\work\@reg32v2\_primary.dat
32位CPU设计\Super\work\@reg32v2\_primary.vhd
32位CPU设计\Super\work\@reg32\verilog.asm
32位CPU设计\Super\work\@reg32\_primary.dat
32位CPU设计\Super\work\@reg32\_primary.vhd
32位CPU设计\Super\work\@reg16\verilog.asm
32位CPU设计\Super\work\@reg16\_primary.dat
32位CPU设计\Super\work\@reg16\_primary.vhd
32位CPU设计\Super\work\@ram\verilog.asm
32位CPU设计\Super\work\@ram\_primary.dat
32位CPU设计\Super\work\@ram\_primary.vhd
32位CPU设计\Super\work\@r@s@reg\verilog.asm
32位CPU设计\Super\work\@r@s@reg\_primary.dat
32位CPU设计\Super\work\@r@s@reg\_primary.vhd
32位CPU设计\Super\work\@pre@read\verilog.asm
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32位CPU设计\Super\work\@pre@read\_primary.vhd
32位CPU设计\Super\work\@mult16_@m\verilog.asm
32位CPU设计\Super\work\@mult16_@m\_primary.dat
32位CPU设计\Super\work\@mult16_@m\_primary.vhd
32位CPU设计\Super\work\@m@u@x8\verilog.asm
32位CPU设计\Super\work\@m@u@x8\_primary.dat
32位CPU设计\Super\work\@m@u@x8\_primary.vhd
32位CPU设计\Super\work\@m@u@x4x8\verilog.asm
32位CPU设计\Super\work\@m@u@x4x8\_primary.dat
32位CPU设计\Super\work\@m@u@x4x8\_primary.vhd
32位CPU设计\Super\work\@m@u@x4x4\verilog.asm
32位CPU设计\Super\work\@m@u@x4x4\_primary.dat
32位CPU设计\Super\work\@m@u@x4x4\_primary.vhd
32位CPU设计\Super\work\@m@u@x4x1\verilog.asm
32位CPU设计\Super\work\@m@u@x4x1\_primary.dat
32位CPU设计\Super\work\@m@u@x4x1\_primary.vhd
32位CPU设计\Super\work\@m@u@x4\verilog.asm
32位CPU设计\Super\work\@m@u@x4\_primary.dat
32位CPU设计\Super\work\@m@u@x4\_primary.vhd
32位CPU设计\Super\work\@m@u@x32x32test\verilog.asm
32位CPU设计\Super\work\@m@u@x32x32test\_primary.dat
32位CPU设计\Super\work\@m@u@x32x32test\_primary.vhd
32位CPU设计\Super\work\@m@u@x32x32\verilog.asm
32位CPU设计\Super\work\@m@u@x32x32\_primary.dat
32位CPU设计\Super\work\@m@u@x32x32\_primary.vhd
32位CPU设计\Super\work\@m@u@x32sp\verilog.asm
32位CPU设计\Super\work\@m@u@x32sp\_primary.dat
32位CPU设计\Super\work\@m@u@x32sp\_primary.vhd
32位CPU设计\Super\work\@m@u@x32\verilog.asm
32位CPU设计\Super\work\@m@u@x32\_primary.dat
32位CPU设计\Super\work\@m@u@x32\_primary.vhd
32位CPU设计\Super\work\@m@u@x2_16\verilog.asm
32位CPU设计\Super\work\@m@u@x2_16\_primary.dat
32位CPU设计\Super\work\@m@u@x2_16\_primary.vhd
32位CPU设计\Super\work\@m@u@x2\verilog.asm
32位CPU设计\Super\work\@m@u@x2\_primary.dat
32位CPU设计\Super\work\@m@u@x2\_primary.vhd
32位CPU设计\Super\work\@logic32\verilog.asm
32位CPU设计\Super\work\@logic32\_primary.dat
32位CPU设计\Super\work\@logic32\_primary.vhd
32位CPU设计\Super\work\@j_@p@a@t@h\verilog.asm
32位CPU设计\Super\work\@j_@p@a@t@h\_primary.dat
32位CPU设计\Super\work\@j_@p@a@t@h\_primary.vhd
32位CPU设计\Super\work\@ins@reg\verilog.asm
32位CPU设计\Super\work\@ins@reg\_primary.dat
32位CPU设计\Super\work\@ins@reg\_primary.vhd
32位CPU设计\Super\work\@inc5\verilog.asm
32位CPU设计\Super\work\@inc5\_primary.dat
32位CPU设计\Super\work\@inc5\_primary.vhd
32位CPU设计\Super\work\@id@reg\verilog.asm
32位CPU设计\Super\work\@id@reg\_primary.dat
32位CPU设计\Super\work\@id@reg\_primary.vhd
32位CPU设计\Super\work\@i@r_@sh@reg8\verilog.asm
32位CPU设计\Super\work\@i@r_@sh@reg8\_primary.dat
32位CPU设计\Super\work\@i@r_@sh@reg8\_primary.vhd
32位CPU设计\Super\work\@i@r_@pt\verilog.asm
32位CPU设计\Super\work\@i@r_@pt\_primary.dat
32位CPU设计\Super\work\@i@r_@pt\_primary.vhd
32位CPU设计\Super\work\@i@r_@p@c\verilog.asm
32位CPU设计\Super\work\@i@r_@p@c\_primary.dat
32位CPU设计\Super\work\@i@r_@p@c\_primary.vhd
32位CPU设计\Super\work\@i@r@loader\verilog.asm
32位CPU设计\Super\work\@i@r@loader\_primary.dat
32位CPU设计\Super\work\@i@r@loader\_primary.vhd
32位CPU设计\Super\work\@i@n@s_@d@e@c@o@d@e@r\verilog.asm
32位CPU设计\Super\work\@i@n@s_@d@e@c@o@d@e@r\_primary.dat
32位CPU设计\Super\work\@i@n@s_@d@e@c@o@d@e@r\_primary.vhd
32位CPU设计\Super\work\@i@m@m@e_@e@x\verilog.asm
32位CPU设计\Super\work\@i@m@m@e_@e@x\_primary.dat
32位CPU设计\Super\work\@i@m@m@e_@e@x\_primary.vhd
32位CPU设计\Super\work\@hard@int\verilog.asm
32位CPU设计\Super\work\@hard@int\_primary.dat
32位CPU设计\Super\work\@hard@int\_primary.vhd
32位CPU设计\Super\work\@g@e@t_@o@p@e@r\verilog.asm
32位CPU设计\Super\work\@g@e@t_@o@p@e@r\_primary.dat
32位CPU设计\Super\work\@g@e@t_@o@p@e@r\_primary.vhd
32位CPU设计\Super\work\@d_flp\verilog.asm
32位CPU设计\Super\work\@d_flp\_primary.dat
32位CPU设计\Super\work\@d_flp\_primary.vhd
32位CPU设计\Super\work\@d_flipflop\verilog.asm
32位CPU设计\Super\work\@d_flipflop\_primary.dat
32位CPU设计\Super\work\@d_flipflop\_primary.vhd
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32位CPU设计\Super\work\@does@write\_primary.dat
32位CPU设计\Super\work\@does@write\_primary.vhd
32位CPU设计\Super\work\@does1@read\verilog.asm
32位CPU设计\Super\work\@does1@read\_primary.dat
32位CPU设计\Super\work\@does1@read\_primary.vhd
32位CPU设计\Super\work\@dec32\verilog.asm
32位CPU设计\Super\work\@dec32\_primary.dat
32位CPU设计\Super\work\@dec32\_primary.vhd
32位CPU设计\Super\work\@dec3\verilog.asm
32位CPU设计\Super\work\@dec3\_primary.dat
32位CPU设计\Super\work\@dec3\_primary.vhd
32位CPU设计\Super\work\@dec2\verilog.asm
32位CPU设计\Super\work\@dec2\_primary.dat
32位CPU设计\Super\work\@dec2\_primary.vhd
32位CPU设计\Super\work\@ctrl@unit\verilog.asm
32位CPU设计\Super\work\@ctrl@unit\_primary.dat
32位CPU设计\Super\work\@ctrl@unit\_primary.vhd
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32位CPU设计\Super\work\@compare5\_primary.dat
32位CPU设计\Super\work\@compare5\_primary.vhd
32位CPU设计\Super\work\@block\verilog.asm
32位CPU设计\Super\work\@block\_primary.dat
32位CPU设计\Super\work\@block\_primary.vhd
32位CPU设计\Super\work\@adder8\verilog.asm
32位CPU设计\Super\work\@adder8\_primary.dat
32位CPU设计\Super\work\@adder8\_primary.vhd
32位CPU设计\Super\work\@adder4_@m\verilog.asm
32位CPU设计\Super\work\@adder4_@m\_primary.dat
32位CPU设计\Super\work\@adder4_@m\_primary.vhd
32位CPU设计\Super\work\@adder4x8\verilog.asm
32位CPU设计\Super\work\@adder4x8\_primary.dat
32位CPU设计\Super\work\@adder4x8\_primary.vhd
32位CPU设计\Super\work\@adder32\verilog.asm
32位CPU设计\Super\work\@adder32\_primary.dat
32位CPU设计\Super\work\@adder32\_primary.vhd
32位CPU设计\Super\work\@adder16_@m\verilog.asm
32位CPU设计\Super\work\@adder16_@m\_primary.dat
32位CPU设计\Super\work\@adder16_@m\_primary.vhd
32位CPU设计\Super\work\@a@l@u\verilog.asm
32位CPU设计\Super\work\@a@l@u\_primary.dat
32位CPU设计\Super\work\@a@l@u\_primary.vhd
32位CPU设计\Super\Shift32\Inc5.v
32位CPU设计\Super\Shift32\Shift32.v
32位CPU设计\Super\Shift32\Shift64_32.v
32位CPU设计\Super\Relative\MUXx1.v
32位CPU设计\Super\Relative\Relative.v
32位CPU设计\Super\Reg32\D_flp.v
32位CPU设计\Super\Reg32\Reg32.v
32位CPU设计\Super\Reg32\RegGroup32.v
32位CPU设计\Super\MUX\MUX32x32.v
32位CPU设计\Super\MUX\MUXx1.v
32位CPU设计\Super\MUX\MUXx1test.v
32位CPU设计\Super\Logic\Logic32.v
32位CPU设计\Super\Decoder\Decoder.v
32位CPU设计\Super\Adder\Adder.v
32位CPU设计\CPU设计报告.doc
32位CPU设计\汇编器相关\WASM\WASM
32位CPU设计\汇编器相关\WASM\Bin2Txt
32位CPU设计\Super\work\@to@jmp
32位CPU设计\Super\work\@sys@ins@ctrl
32位CPU设计\Super\work\@super@c@p@u
32位CPU设计\Super\work\@shift64_32
32位CPU设计\Super\work\@shift32
32位CPU设计\Super\work\@s@y@s_@i@n@s_@d@e@c@o@d@e@r
32位CPU设计\Super\work\@reg@group32v3
32位CPU设计\Super\work\@reg@group32v2
32位CPU设计\Super\work\@reg@group32
32位CPU设计\Super\work\@reg@flag
32位CPU设计\Super\work\@reg32v2
32位CPU设计\Super\work\@reg32
32位CPU设计\Super\work\@reg16
32位CPU设计\Super\work\@ram
32位CPU设计\Super\work\@r@s@reg
32位CPU设计\Super\work\@pre@read
32位CPU设计\Super\work\@mult16_@m
32位CPU设计\Super\work\@m@u@x8
32位CPU设计\Super\work\@m@u@x4x8
32位CPU设计\Super\work\@m@u@x4x4
32位CPU设计\Super\work\@m@u@x4x1
32位CPU设计\Super\work\@m@u@x4
32位CPU设计\Super\work\@m@u@x32x32test
32位CPU设计\Super\work\@m@u@x32x32
32位CPU设计\Super\work\@m@u@x32sp
32位CPU设计\Super\work\@m@u@x32
32位CPU设计\Super\work\@m@u@x2_16
32位CPU设计\Super\work\@m@u@x2
32位CPU设计\Super\work\@logic32
32位CPU设计\Super\work\@j_@p@a@t@h
32位CPU设计\Super\work\@ins@reg
32位CPU设计\Super\work\@inc5
32位CPU设计\Super\work\@id@reg
32位CPU设计\Super\work\@i@r_@sh@reg8
32位CPU设计\Super\work\@i@r_@pt
32位CPU设计\Super\work\@i@r_@p@c
32位CPU设计\Super\work\@i@r@loader
32位CPU设计\Super\work\@i@n@s_@d@e@c@o@d@e@r
32位CPU设计\Super\work\@i@m@m@e_@e@x
32位CPU设计\Super\work\@hard@int
32位CPU设计\Super\work\@g@e@t_@o@p@e@r
32位CPU设计\Super\work\@d_flp
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32位CPU设计\Super\work\@does@write
32位CPU设计\Super\work\@does1@read
32位CPU设计\Super\work\@dec32
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32位CPU设计\Super\work\@compare5
32位CPU设计\Super\work\@block
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32位CPU设计\Super\work\@adder4_@m
32位CPU设计\Super\work\@adder4x8
32位CPU设计\Super\work\@adder32
32位CPU设计\Super\work\@adder16_@m
32位CPU设计\Super\work\@a@l@u
32位CPU设计\汇编器相关\WASM
32位CPU设计\Super\work
32位CPU设计\Super\Shift32
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32位CPU设计\Super\Reg32
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32位CPU设计\Super\Logic
32位CPU设计\Super\Decoder
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