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数字钟，用VHDL写的各个模块，顶层用图形编辑，在实验箱上完全通过-Digital clock, using VHDL written by various modules, top-level graphics editing, in the experimental box completely through
(系统自动生成,下载前可以参看下载内容)
下载文件列表
数字钟
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......\cont.asm.rpt
......\cont.done
......\cont.fit.rpt
......\cont.fit.summary
......\cont.flow.rpt
......\cont.map.rpt
......\cont.map.summary
......\cont.pin
......\cont.pof
......\cont.qpf
......\cont.qsf
......\cont.qws
......\cont.sim.rpt
......\cont.sof
......\cont.tan.rpt
......\cont.tan.summary
......\cont.vwf
......\db
......\..\cont.asm.qmsg
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......\..\cont.cmp.cdb
......\..\cont.cmp.hdb
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......\..\cont.cmp0.ddb
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......\..\cont.eco.cdb
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......\..\cont.pss
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......\利用VHDL语言设计的数字钟.doc
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......\利用VHDL语言设计的数字钟.doc