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文件名称:sdr_c_trl_verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2012-11-26
  • 文件大小：
  • 12kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 曹**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

SDRAM 控制器的Verilog代码

经过综合验证过的.无截压密码-SDRAM controller Verilog code comprehensive test after all. No cut-off pressure Password
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sdram控制器
SDRAM
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fpga
ram

(系统自动生成,下载前可以参看下载内容)

下载文件列表

verilog

.......\source

.......\......\altclklock.v

.......\......\Command.v

.......\......\compile_all.v

.......\......\control_interface.v

.......\......\Params.v

.......\......\PLL1.v

.......\......\sdr_data_path.v

.......\......\sdr_sdram.v

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