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文件名称:jtag_verilog

  • 所属分类：
  • 其它
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2008-10-13
  • 文件大小：
  • 5.91kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 陈*
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog 实现的jtag ip模块

包括了测试程序-Verilog achieve the JTAG ip modules including test procedures
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 119128664jtag_verilog.rar 列表
tap_defines.v
tap_test.v
tap_top.v
timescale.v

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