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文件名称:asynchoronization_FIFO_design

  • 所属分类：
  • 其它资源
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2008-10-13
  • 文件大小：
  • 2.56kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 李**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

《Verilog HDL 语言编程》

异步FIFO设计（基于Verilog)


(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 57578847asynchoronization_fifo_design.rar 列表
dp_ram.v
rptr_empty.v
wptr_full.v
async_cmp.v
async_fifo.v

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