文件名称:ADC
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用verilog编程实现的基于FPGA的AD数据采集程序
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压缩包 : 61549832adc.rar 列表 adc_1\adc_1.asm.rpt adc_1\adc_1.done adc_1\adc_1.fit.eqn adc_1\adc_1.fit.rpt adc_1\adc_1.fit.summary adc_1\adc_1.flow.rpt adc_1\adc_1.map.eqn adc_1\adc_1.map.rpt adc_1\adc_1.map.summary adc_1\adc_1.pin adc_1\adc_1.pof adc_1\adc_1.qpf adc_1\adc_1.qsf adc_1\adc_1.qws adc_1\adc_1.sof adc_1\adc_1.tan.rpt adc_1\adc_1.tan.summary adc_1\adc_1.v adc_1\cmp_state.ini adc_1\db\adc_1.(0).cnf.cdb adc_1\db\adc_1.(0).cnf.hdb adc_1\db\adc_1.asm.qmsg adc_1\db\adc_1.cbx.xml adc_1\db\adc_1.cmp.cdb adc_1\db\adc_1.cmp.hdb adc_1\db\adc_1.cmp.rdb adc_1\db\adc_1.cmp.tdb adc_1\db\adc_1.cmp0.ddb adc_1\db\adc_1.db_info adc_1\db\adc_1.eco.cdb adc_1\db\adc_1.fit.qmsg adc_1\db\adc_1.hier_info adc_1\db\adc_1.hif adc_1\db\adc_1.map.cdb adc_1\db\adc_1.map.hdb adc_1\db\adc_1.map.qmsg adc_1\db\adc_1.pre_map.cdb adc_1\db\adc_1.pre_map.hdb adc_1\db\adc_1.psp adc_1\db\adc_1.rtlv.hdb adc_1\db\adc_1.rtlv_sg.cdb adc_1\db\adc_1.rtlv_sg_swap.cdb adc_1\db\adc_1.sgdiff.cdb adc_1\db\adc_1.sgdiff.hdb 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