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文件名称:扰码器Verilog

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • 上传时间：
  • 2018-04-01
  • 文件大小：
  • 509kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 不会飞***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

实现扰码的功能，主要为64位在pcs子层传输的扰码器设计(To achieve the functions of scrambling code)
相关搜索： 64位扰码器

(系统自动生成,下载前可以参看下载内容)

下载文件列表

文件名大小更新时间
扰码器Verilog.doc 601600 2018-04-01

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