文件名称:DDS30k

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2018-03-26
  • 文件大小:
  • 5.93mb
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在quartus开发平台基于直接数字频率合成技术利用Verilog语言实现正弦信号和三角波信号发生(Verilog was used to generate sine and triangle wave signals based on direct digital frequency synthesis in quartus development platform.)
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文件名大小更新时间
DDS30k\adda_clk.bsf 1777 2017-12-25
DDS30k\adda_clk.v 172 2017-12-25
DDS30k\adder.bsf 2162 2017-12-25
DDS30k\adder.v 179 2017-12-25
DDS30k\ad_reg.bsf 1593 2017-12-25
DDS30k\ad_reg.v 215 2017-12-25
DDS30k\db\altsyncram_4124.tdf 22593 2017-12-25
DDS30k\db\altsyncram_d9c2.tdf 16300 2017-12-25
DDS30k\db\altsyncram_fpa1.tdf 2907 2017-12-25
DDS30k\db\altsyncram_obc2.tdf 16291 2017-12-25
DDS30k\db\altsyncram_qra1.tdf 2906 2017-12-25
DDS30k\db\cmpr_ngc.tdf 1684 2017-12-25
DDS30k\db\cmpr_rgc.tdf 2006 2017-12-25
DDS30k\db\cntr_23j.tdf 3298 2017-12-25
DDS30k\db\cntr_egi.tdf 3864 2017-12-25
DDS30k\db\cntr_fgi.tdf 3183 2017-12-25
DDS30k\db\cntr_g9j.tdf 4102 2017-12-25
DDS30k\db\decode_dvf.tdf 1565 2017-12-25
DDS30k\db\driver.(0).cnf.cdb 3078 2017-12-25
DDS30k\db\driver.(0).cnf.hdb 1190 2017-12-25
DDS30k\db\driver.(1).cnf.cdb 550 2017-12-25
DDS30k\db\driver.(1).cnf.hdb 557 2017-12-25
DDS30k\db\driver.(10).cnf.cdb 1831 2017-12-25
DDS30k\db\driver.(10).cnf.hdb 993 2017-12-25
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DDS30k\db\driver.(12).cnf.hdb 972 2017-12-25
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