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文件名称:ahb

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2017-11-05
  • 文件大小：
  • 36kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • 落叶无情*****
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

verilog实现AHB总线上的主从控制，在fpga上验证通过(Verilog realizes master slave control on AHB bus and verifies it on FPGA)
相关搜索： AHB
verilog

(系统自动生成,下载前可以参看下载内容)

下载文件列表

ahb_sdr\tb\mt48lc4m32b2.v

ahb_sdr\tb\tb_sdr.v

ahb_sdr\src\verilog\ahb_sdrctrl.v

ahb_sdr\src\verilog\defines.v

ahb_sdr\sim\modelSim\sim_gui.bat

ahb_sdr\sim\modelSim\sim.do

ahb_sdr\sim\modelSim\transcript

ahb_sdr\sim\modelSim\signal.f

ahb_sdr\doc\design\Thumbs.db

ahb_sdr\src\vhdl

ahb_sdr\src\verilog

ahb_sdr\sim\modelSim

ahb_sdr\sim\vcs

ahb_sdr\syn\synopsys

ahb_sdr\syn\ise

ahb_sdr\syn\synplify

ahb_sdr\doc\verification

ahb_sdr\doc\design

ahb_sdr\tb

ahb_sdr\c

ahb_sdr\src

ahb_sdr\sim

ahb_sdr\syn

ahb_sdr\doc

ahb_sdr

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