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文件名称:adder

  • 所属分类：
  • 其它资源
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2008-10-13
  • 文件大小：
  • 1.46kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • liu***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

此程序为用VERLOG HDL编写的一个完整的3位加法器。
(系统自动生成,下载前可以参看下载内容)

下载文件列表

压缩包 : 25811221adder.rar 列表
第一次作业加法器\half_adder.v
第一次作业加法器\ test_bench.v
第一次作业加法器\adder_1.v
第一次作业加法器\adder_3.v
第一次作业加法器

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