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文件名称:lab6-3-8DECODER

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [VHDL] [源码]
  • 上传时间：
  • 2016-10-24
  • 文件大小：
  • 73kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • FAN***
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

数字设计和计算机体系结构：用verilog语言描述3-8译码器的设计与实现-Digital design and computer architecture: use verilog language describe 3-8 decoder design and implementation
(系统自动生成,下载前可以参看下载内容)

下载文件列表





sim_decoder.v

实验报告lab6.docx

decoder3_8.v

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