文件名称:altdq_dqs2

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • [VHDL] [源码]
  • 上传时间:
  • 2016-01-03
  • 文件大小:
  • 2.15mb
  • 下载次数:
  • 0次
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altera ip a ltera ip-altera ip altera ip altera ip
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altdq_dqs2

..........\abstract

..........\........\altdq_dqs2_abstract.sv

..........\........\altdq_dqs2_cal_delays_arriaiigx.sv

..........\........\altdq_dqs2_cal_delays_arriavgz.sv

..........\........\altdq_dqs2_cal_delays_presv_arriaiigz.sv

..........\........\altdq_dqs2_cal_delays_presv_arriavgz.sv

..........\........\altdq_dqs2_cal_delays_presv_stratixiii.sv

..........\........\altdq_dqs2_cal_delays_presv_stratixiv.sv

..........\........\altdq_dqs2_cal_delays_presv_stratixv.sv

..........\........\altdq_dqs2_cal_delays_stratixv.sv

..........\altdq_dqs2_acv_arriav.sv

..........\altdq_dqs2_acv_arriav_connect_to_hard_phy.sv

..........\altdq_dqs2_acv_arriav_connect_to_hard_phy_lpddr2.sv

..........\altdq_dqs2_acv_arriav_lpddr2.sv

..........\altdq_dqs2_acv_arriav_quarter_rate_mode.sv

..........\altdq_dqs2_acv_connect_to_hard_phy_cyclonev.sv

..........\altdq_dqs2_acv_connect_to_hard_phy_cyclonev_lpddr2.sv

..........\altdq_dqs2_acv_cyclonev.sv

..........\altdq_dqs2_acv_cyclonev_lpddr2.sv

..........\altdq_dqs2_acv_cyclonev_quarter_rate_mode.sv

..........\altdq_dqs2_arriaiigx_ddio_3reg_family_has_no_dynconf.sv

..........\altdq_dqs2_arriaiigx_ddio_3reg_family_has_no_dynconf_use_offset_ctrl.sv

..........\altdq_dqs2_arriaiigz_ddio_3reg.sv

..........\altdq_dqs2_arriaiigz_ddio_3reg_use_offset_ctrl.sv

..........\altdq_dqs2_arriavgz.sv

..........\altdq_dqs2_arriavgz_use_offset_ctrl.sv

..........\altdq_dqs2_arriavgz_use_shadow_regs.sv

..........\altdq_dqs2_ddio_3reg_stratixiii.sv

..........\altdq_dqs2_ddio_3reg_stratixiii_use_offset_ctrl.sv

..........\altdq_dqs2_ddio_3reg_stratixiv.sv

..........\altdq_dqs2_ddio_3reg_stratixiv_use_offset_ctrl.sv

..........\altdq_dqs2_hw.tcl

..........\altdq_dqs2_stratixv.sv

..........\altdq_dqs2_stratixv_use_external_write_strobe_ports.sv

..........\altdq_dqs2_stratixv_use_offset_ctrl.sv

..........\altdq_dqs2_stratixv_use_shadow_regs.sv

..........\altdq_dqs2_wizard.lst

..........\example.v

..........\example_design

..........\..............\config_controller.sv

..........\..............\config_controller_acv.sv

..........\..............\dllex.v

..........\..............\dqsagent.sv

..........\..............\dqsdriver.sv

..........\..............\dqsdriver_microcode_bidir.sv

..........\..............\dqsdriver_microcode_input.sv

..........\..............\dqsdriver_microcode_output.sv

..........\..............\octex.v

..........\..............\pllex.qip

..........\..............\pllex.v

..........\..............\tb.v

..........\..............\top.v

..........\generate.tcl

..........\mentor

..........\......\abstract

..........\......\........\altdq_dqs2_abstract.sv

..........\......\........\altdq_dqs2_cal_delays_arriaiigx.sv

..........\......\........\altdq_dqs2_cal_delays_arriavgz.sv

..........\......\........\altdq_dqs2_cal_delays_presv_arriaiigz.sv

..........\......\........\altdq_dqs2_cal_delays_presv_arriavgz.sv

..........\......\........\altdq_dqs2_cal_delays_presv_stratixiii.sv

..........\......\........\altdq_dqs2_cal_delays_presv_stratixiv.sv

..........\......\........\altdq_dqs2_cal_delays_presv_stratixv.sv

..........\......\........\altdq_dqs2_cal_delays_stratixv.sv

..........\......\altdq_dqs2_acv_arriav.sv

..........\......\altdq_dqs2_acv_arriav_connect_to_hard_phy.sv

..........\......\altdq_dqs2_acv_arriav_connect_to_hard_phy_lpddr2.sv

..........\......\altdq_dqs2_acv_arriav_lpddr2.sv

..........\......\altdq_dqs2_acv_arriav_quarter_rate_mode.sv

..........\......\altdq_dqs2_acv_connect_to_hard_phy_cyclonev.sv

..........\......\altdq_dqs2_acv_connect_to_hard_phy_cyclonev_lpddr2.sv

..........\......\altdq_dqs2_acv_cyclonev.sv

..........\......\altdq_dqs2_acv_cyclonev_lpddr2.sv

..........\......\altdq_dqs2_acv_cyclonev_quarter_rate_mode.sv

..........\......\altdq_dqs2_arriaiigx_ddio_3reg_family_has_no_dynconf.sv

..........\......\altdq_dqs2_arriaiigx_ddio_3reg_family_has_no_dynconf_use_offset_ctrl.sv

..........\......\altdq_dqs2_arriaiigz_ddio_3reg.sv

..........\......\altdq_dqs2_arriaiigz_ddio_3reg_use_offset_ctrl.sv

..........\......\altdq_dqs2_arriavgz.sv

..........\......\altdq_dqs2_ar

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