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文件名称:tugedafinal

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [Text]
  • 上传时间：
  • 2015-12-29
  • 文件大小：
  • 1kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • wang*****
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  • 无
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  • 别用迅雷下载，失败请重下，重下不扣分！
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别用迅雷、360浏览器下载。
如迅雷强制弹出，可右键点击选“另存为”。
失败请重下，重下不扣分。
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

使用Verilog HDL语言写的关于实现对ADC、MDC控制的程序，个人使用Quartus 7.2,在上面进行过仿真，暂时还没有发现问题-Using Verilog HDL language written on the realization of the ADC, MDC control procedures, personal use Quartus 7.2, in the above simulation carried out have had no problems found
(系统自动生成,下载前可以参看下载内容)

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tugedafinal.txt

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