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文件名称:state-machine

  • 所属分类：
  • VHDL编程
  • 资源属性：
  • [WORD]
  • 上传时间：
  • 2015-03-30
  • 文件大小：
  • 69kb
  • 下载次数：
  • 0次
  • 提 供 者：
  • c**
  • 相关连接：
  • 无
  • 下载说明：
  • 别用迅雷下载，失败请重下，重下不扣分！
修正介绍说明

介绍说明－－下载内容均来自于网络，请自行研究使用

一个简单的用verilog实现的售货机状态机设计，内有word介绍设计的原理-A simple realization of a vending machine with verilog state machine design, there are design principles introduced word
(系统自动生成,下载前可以参看下载内容)

下载文件列表





状态机设计\state_machine_1.v

..........\state_machine_tb.txt

..........\state_machine_tb.v

..........\wave3.bmp

..........\实验二图.doc

..........\实验报告二.doc

状态机设计

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