文件名称:multi_clock_design_in_large_scale_FPGA
介绍说明--下载内容均来自于网络,请自行研究使用
用FPGA实现大型设计时,可能需要FPGA具有以多个时钟运行的多重数据通路,这种多时钟FPGA设计必须特别小心,需要注意最大时钟速率、抖动、最大时钟数、异步时钟设计和时钟/数据关系。设计过程中最重要的一步是确定要用多少个不同的时钟,以及如何进行布线
(系统自动生成,下载前可以参看下载内容)
下载文件列表
压缩包 : 89346490multi_clock_design_in_large_scale_fpga.rar 列表 大型设计中FPGA的多时钟设计策略.doc