文件名称:fdiv7

  • 所属分类:
  • VHDL编程
  • 资源属性:
  • 上传时间:
  • 2014-03-11
  • 文件大小:
  • 31kb
  • 下载次数:
  • 0次
  • 提 供 者:
  • 沈*
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程序实现对输入时钟信号的7分频,程序采用两个计数器,一个由输入时钟的上升沿触发,另一个由时钟的下降沿触发,最后将2个计数器的输出相或,即得到占空比为50 的方波。-Program realizes frequency devision-by-7 of the input clock signal , the program uses two counters, one triggered by the rising edge of the input clock, and the other triggered by the falling edge of the clock.Then I operate "or" arithmetic to the output of two counters.In the last,I obtained the square wave of 50 duty ratio.
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fdiv7.fit.summary

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fdiv7.map.rpt

fdiv7.map.summary

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fdiv7.qsf

fdiv7.qws

fdiv7.sim.rpt

fdiv7.tan.rpt

fdiv7.tan.summary

fdiv7.vhd

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fdiv7.asm.rpt

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