文件名称:keyqudou
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fpga verilog hdl 设计键盘去抖动程序，设计环境quartusii 9.0。仿真绝对通过。-fpga verilog hdl design keyboard to jitter program design environment quartusii 9.0. Simulation absolutely pass.
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下载文件列表
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........\..\keyqudou.cmp.cdb
........\..\keyqudou.cmp.hdb
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........\..\keyqudou.cmp.tdb
........\..\keyqudou.cmp0.ddb
........\..\keyqudou.db_info
........\..\keyqudou.eco.cdb
........\..\keyqudou.eda.qmsg
........\..\keyqudou.fit.qmsg
........\..\keyqudou.hier_info
........\..\keyqudou.hif
........\..\keyqudou.lpc.html
........\..\keyqudou.lpc.rdb
........\..\keyqudou.lpc.txt
........\..\keyqudou.map.cdb
........\..\keyqudou.map.hdb
........\..\keyqudou.map.logdb
........\..\keyqudou.map.qmsg
........\..\keyqudou.pre_map.cdb
........\..\keyqudou.pre_map.hdb
........\..\keyqudou.rtlv.hdb
........\..\keyqudou.rtlv_sg.cdb
........\..\keyqudou.rtlv_sg_swap.cdb
........\..\keyqudou.sgdiff.cdb
........\..\keyqudou.sgdiff.hdb
........\..\keyqudou.sld_design_entry.sci
........\..\keyqudou.sld_design_entry_dsc.sci
........\..\keyqudou.syn_hier_info
........\..\keyqudou.tan.qmsg
........\..\keyqudou.tis_db_list.ddb
........\..\prev_cmp_keyqudou.asm.qmsg
........\..\prev_cmp_keyqudou.eda.qmsg
........\..\prev_cmp_keyqudou.fit.qmsg
........\..\prev_cmp_keyqudou.map.qmsg
........\..\prev_cmp_keyqudou.qmsg
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........\incremental_db\compiled_partitions\keyqudou.root_partition.map.kpt
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........\keyqudou.eda.rpt
........\keyqudou.fit.rpt
........\keyqudou.fit.summary
........\keyqudou.flow.rpt
........\keyqudou.map.rpt
........\keyqudou.map.smsg
........\keyqudou.map.summary
........\keyqudou.pin
........\keyqudou.pof
........\keyqudou.qpf
........\keyqudou.qsf
........\keyqudou.sof
........\keyqudou.tan.rpt
........\keyqudou.tan.summary
........\keyqudou.v
........\keyqudou.v.bak
........\keyqudou_nativelink_simulation.rpt
........\simulation\modelsim\keyqudou.sft
........\..........\........\keyqudou.vo
........\..........\........\keyqudou_modelsim.xrf
........\..........\........\keyqudou_run_msim_gate_verilog.do
........\..........\........\keyqudou_run_msim_gate_verilog.do.bak
........\..........\........\keyqudou_v.sdo
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........\..........\........\............\............\.................\_primary.dbs
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